- •Путилин а.Б. Организация эвм и систем
- •Глава 11. Общая характеристика микропроцессоров 154
- •Глава 12. Интерфейсы программно-модульных и
- •Глава 13. Интерфейсы и шины персональных эвм 221
- •Введение
- •Глава 1 Представление информации в информационных системах
- •1.1. Понятие об информации и информационных процессах
- •1.2. Сигналы и информация
- •1.3. Виды информации и их классификация
- •1.4. Структура информации
- •1.5. Дискретизация сигналов при вводе в эвм
- •Контрольные вопросы
- •Глава 2 Аналоговые вычислительные устройства
- •2.1. Методы моделирования
- •2.2. Методы построения аналоговых вычислительных устройств
- •2.3. Основные характеристики аву
- •2.4. Функциональные устройства
- •2.5. Суммирующие и вычитающие устройства
- •2.6. Дифференцирующие устройства
- •2.7. Интегрирующие устройства
- •Контрольные вопросы
- •Глава 3 Цифровые вычислительные устройства
- •3.1. Основные понятия и определения цифровой вычислительной техники.
- •3.2. Характеристики эвм
- •3.3. Поколения эвм
- •Контрольные вопросы
- •Глава 4 Математическое введение в цифровую вычислительную технику.
- •4.1. Системы счисления, используемые в эвм
- •4.2. Формы представления числовой информации в эвм
- •4.3. Машинные коды чисел
- •4.4. Кодирование алфавитно-цифровой информации
- •4.5. Элементы алгебры логики
- •4.6. Функционально полные системы
- •4.7. Минимизация функций алгебры логики
- •Контрольные вопросы
- •Глава 5 Комбинационные цифровые устройства
- •5.1. Понятие о комбинационных и последовательностных цифровых устройствах
- •5.2. Базовые интегральные логические элементы
- •5.3. Синтез кцу
- •Контрольные вопросы
- •Глава 6 Типовые кцу
- •6.1. Дешифраторы
- •6.2. Шифраторы
- •6.3. Мультиплексоры
- •6.4. Сумматоры
- •Контрольные вопросы
- •Глава 7 Анализ работы кцу
- •7.1. Быстродействие кцу
- •7.2. Состязания в кцу
- •Контрольные вопросы
- •Глава 8 Понятие о пцу
- •8.1. Основные определения и структура пцу
- •8.2. Классификация триггеров
- •8.3. Асинхронный rs-триггер с прямыми входами
- •8.4. Синхронный rs–триггер со статическим управлением
- •8.5. Универсальный jk–триггер
- •Контрольные вопросы
- •Глава 9 Типовые пцу
- •9.1. Регистры
- •9.2. Cчетчики
- •9.3. Сумматоры на основе пцу
- •9.4. Построение запоминающих устройств
- •Контрольные вопросы
- •Глава 10 Аналого-цифровые и цифро-аналоговые преобразователи
- •10.1. Аналого-цифровые преобразователи (ацп)
- •10.2. Ацп с интегрированием
- •10.3. Ацп c последовательным сравнением
- •10.4. Ацп с преобразованием измеряемой величины в кодируемый временной интервал
- •10.5. Ацп двоичного поразрядного уравновешивания
- •10.6. Основные характеристики ацп
- •10.7. Цифро-аналоговые преобразователи (цап)
- •Контрольные вопросы
- •Глава 11 Общая характеристика микропроцессоров
- •11.1. Использование микропроцессоров в иит
- •11.2. Структура микропроцессоров
- •11.3. Классификация микропроцессоров
- •11.4. Программное управление мп
- •11.5. Особенности построения модульных мп
- •11.6. Принципы организации эвм с использованием мп
- •Контрольные вопросы
- •Глава 12 Интерфейсы информационных и вычислительных систем
- •12.1. Назначение и характеристики интерфейсов
- •12.2. Принципы организации интерфейсов
- •12.3. Классификация интерфейсов
- •12.4. Системные интерфейсы мини- и микроЭвм. Общая характеристика системных интерфейсов
- •12.5. Интерфейсы мини- и микроЭвм рдр –11
- •12.6. Интерфейсы мини- и микроЭвм nova
- •12.7. Интерфейсы 8- и 16-разрядных микроЭвм
- •12.8. Устройства согласования системных интерфейсов
- •Контрольные вопросы
- •Глава 13 Малые интерфейсы стандартных устройств
- •13.1. Общая характеристика
- •13.2. Интерфейс ирпр
- •13.3. Интерфейс ирпс
- •Глава 14
- •14.1. Программно-модульный интерфейс iec 625-1. Общая характеристика интерфейса
- •14.2. Логическая организация интерфейса
- •14.3. Схемы поддержки и бис для интерфейса
- •14.4. Локальные системы на базе интерфейса
- •14.5. Интерфейсы магистрально-модульных и мультимикропроцессорных систем. Развитие интерфейсов системы камак
- •14.6. Интерфейсы системы Multibus
- •14.7. Интерфейс системы Fastbus
- •Контрольные вопросы
- •Глава 15 Интерфейсы и шины персональных эвм
- •15.1. Общая характеристика интерфейсов
- •15.2 Последовательный и параллельный интерфейсы
- •15.3. Универсальная последовательная шина usb
- •Топология
- •Кабели и разъемы
- •15.4. Интерфейс портативных компьютеров (pcmcia)
- •15.5. Шины персональных компьютеров эвм серии pc/at
- •Факс-модем
- •Принтер
- •15.6. Локальные шины (Local bus и vl-bus)
- •15.7. Интерфейс FireWare
- •Контрольные вопросы
- •Литература
- •Термины и определения
9.4. Построение запоминающих устройств
При построении сложных ПЦУ необходимо обеспечить хранение больших объемов информации с простым и удобным доступом к ней. Для этого проектируются специальные ПЦУ, получившие название запоминающих устройств или устройств памяти. Для любого устройства памяти должен быть определен базовый элемент памяти. Кроме того, должны быть выбраны метод выделения выборки заданных элементов из общего массива элементов памяти, а так же метод передачи информации для хранения в памяти записи и выдачи информации из памяти чтения. Сначала осуществляется проектирование базового элемента памяти, а затем - всего устройства памяти.
При синтезе элемента памяти для хранения одного бита информации, условия работы элемента памяти словесно описываются следующим образом: выбор элемента осуществляется подачей сигнала выборки на вход С; с помощью сигнала на входе С определяется состояние элемента памяти по сигналу Q; если элемент памяти хранит 1 бит информации, то на его выходе Y выдается сигнал 1 (осуществляется чтение); для записи информации необходимо подать на вход I соответствующее значение бита информации и на вход V – сигнал разрешения записи. Для синтеза базового элемента используют логические элементы И, НЕ, а также RS-триггер, который обеспечивает запоминания.
Рис. 9.4.1. Структурная схема базового элемента памяти
Рис. 9.4.2. Схема базового элемента памяти с использованием логических элементов И, НЕ и RS-триггеров.
Рис. 9.4.3. Условное обозначение базового элемента памяти.
Приведенное словесное описание работы элемента памяти можно использовать в качестве модели для его построения. Из описания следует, что на входе RS-триггера должно быть предусмотрено КЦУ1 с тремя входами C, I, V и двумя выходами S и R для переключения RS-триггера. На выходе элемента памяти должно быть предусмотрено КЦУ2 с входами C и Q, а также выходом Y (рис. 9.4.1). Используя словесную запись условий работы ЗУ запишем аналитические выражения для каждого из сигналов. Выходной сигнал Y формируется по состоянию триггера и выдаётся при наличии сигнала С, т.е. Y=CQ;
Для формирования сигнала записи S сигнала в триггер необходимо выполнение условия: S=JCV;
Д ля записи "0" в триггер необходимо подать сигнал R=JCV; Таблицы истинности имеют вид представленный в табл. 9.4.
Таблица. 9.4. Таблица истинности базового элемента памяти
-
C
Y
V
R
S
0
0
0
0
0
0
0
1
0
0
0
1
0
0
0
0
1
1
0
0
1
0
0
0
0
1
0
1
1
0
1
1
0
0
0
1
1
1
0
1
-
C
Q
Y
0
0
0
0
1
0
1
0
0
1
1
1
Схема варианта базового элемента памяти с использованием логических элементов И, НЕ и RS-триггеров приведена на рис. 9.4.2, а его условное обозначение на рис. 9.4.3.
Устройство памяти для хранения четырех 2-разрядных двоичных чисел содержит в основе подобную структуру. Оно обладает следующими свойствами:
допускается выборка в каждый момент времени только одного числа;
все разряды данного числа можно одновременно читать или изменять в режиме записи;
каждое число имеет порядковый номер – адрес, числа расположены в порядке возрастания их адресов;
адрес задается двоичным числом, число разрядов в котором зависит от количества слов, хранимых в памяти.
В рассматриваемом случае адрес представляет собой 2-разрядное двоичное число.
Такая организация хранения чисел принята в памяти с линейной выборкой. Устройство памяти функционирует следующим образом. По адресу выбирается число, для этого используют сигналы чтения или записи, с их помощью можно выбрать или записать в память 2-разрядное двоичное число. Для построения устройства памяти используются регистры, дешифраторы, логические элементы, элементы памяти.
Сложные ПЦУ стремятся строить, как правило, в виде регулярных схем из однотипных элементов на базе типовых функциональных узлов ПЦУ и КДУ. Это позволяет существенно упростить процесс проектирования и получить приемлемые для практики решения.
Из приведенного описания устройства памяти следует вывод, что схема может быть представлена в виде регулярной структуры из элементов памяти, дополненной схемой ПЦУ из типовых узлов для управления выборкой, записью и чтением.
Пример реализации показан на рис.9.4.4.
а) Схема памяти б)Условное обозначение
для хранения схемы
2-разрядных двоичных чисел.
Рис. 9.4.4. Схема памяти
Элементы памяти располагают в соответствии с регулярным размещением разрядов последовательности 2-разрядных двоичных чисел (рис. 9.4.4 а). Поскольку из памяти каждый раз выбирается только одно 2-разрядмое двоичное число и оба разряда могут считываться одновременно, то можно объединить выходы соответствующих разрядов всех чисел, как показано на рис. 9.4.4. а. Легко заметить, что разрешение на запись можно подавать на входы всех элементов памяти, так как с помощью сигнала записи лишь выбирается режим работы.
Для записи же числа в память необходимо задать адрес числа и записываемую информацию. Это позволяет соединить вместе входы записи W элементов памяти. Входы I элементов памяти можно также соединить поразрядно для всех чисел. Входы С элементов памяти для разрядов данного двоичного числа можно также соединить вместе, поскольку каждый раз выбирается одно двоичное число. Полученная таким образом схема устройства памяти состоит из одинаковых элементов памяти и имеет по числу хранимых чисел 4 входа для их выборки, 2 входа I для ввода информации и 2 выхода Y для выбора информации (в соответствии с числом разрядов). Условное обозначение схемы устройства памяти приведено на рис. 9.4.4. б, полной схемы – на рис. 9.4.5. Для выбора адреса числа из памяти используется регистр хранения адреса и дешифратор DC. Для управления чтением числа из памяти используются элемент И.
Рис. 9.4.5. Полная схема устройства хранения 2-разрядных двоичных чисел
Важно отметить, что устройство памяти представляет собой сложное устройство состоящее из более простых функциональных узлов. Функциональные узлы являются типовыми: счетчики, регистры, шифраторы, дешифраторы и т.д. В тех случаях, когда требуется ввести новый функциональный узел, отличающийся от типовых, его можно синтезировать, используя методы синтеза конечных автоматов. Из функциональных узлов строится схема ПЦУ с соблюдением правил композиции, используемых в структурной теории автоматов и изложенной при рассмотрении ПЦУ.