- •Путилин а.Б. Организация эвм и систем
- •Глава 11. Общая характеристика микропроцессоров 154
- •Глава 12. Интерфейсы программно-модульных и
- •Глава 13. Интерфейсы и шины персональных эвм 221
- •Введение
- •Глава 1 Представление информации в информационных системах
- •1.1. Понятие об информации и информационных процессах
- •1.2. Сигналы и информация
- •1.3. Виды информации и их классификация
- •1.4. Структура информации
- •1.5. Дискретизация сигналов при вводе в эвм
- •Контрольные вопросы
- •Глава 2 Аналоговые вычислительные устройства
- •2.1. Методы моделирования
- •2.2. Методы построения аналоговых вычислительных устройств
- •2.3. Основные характеристики аву
- •2.4. Функциональные устройства
- •2.5. Суммирующие и вычитающие устройства
- •2.6. Дифференцирующие устройства
- •2.7. Интегрирующие устройства
- •Контрольные вопросы
- •Глава 3 Цифровые вычислительные устройства
- •3.1. Основные понятия и определения цифровой вычислительной техники.
- •3.2. Характеристики эвм
- •3.3. Поколения эвм
- •Контрольные вопросы
- •Глава 4 Математическое введение в цифровую вычислительную технику.
- •4.1. Системы счисления, используемые в эвм
- •4.2. Формы представления числовой информации в эвм
- •4.3. Машинные коды чисел
- •4.4. Кодирование алфавитно-цифровой информации
- •4.5. Элементы алгебры логики
- •4.6. Функционально полные системы
- •4.7. Минимизация функций алгебры логики
- •Контрольные вопросы
- •Глава 5 Комбинационные цифровые устройства
- •5.1. Понятие о комбинационных и последовательностных цифровых устройствах
- •5.2. Базовые интегральные логические элементы
- •5.3. Синтез кцу
- •Контрольные вопросы
- •Глава 6 Типовые кцу
- •6.1. Дешифраторы
- •6.2. Шифраторы
- •6.3. Мультиплексоры
- •6.4. Сумматоры
- •Контрольные вопросы
- •Глава 7 Анализ работы кцу
- •7.1. Быстродействие кцу
- •7.2. Состязания в кцу
- •Контрольные вопросы
- •Глава 8 Понятие о пцу
- •8.1. Основные определения и структура пцу
- •8.2. Классификация триггеров
- •8.3. Асинхронный rs-триггер с прямыми входами
- •8.4. Синхронный rs–триггер со статическим управлением
- •8.5. Универсальный jk–триггер
- •Контрольные вопросы
- •Глава 9 Типовые пцу
- •9.1. Регистры
- •9.2. Cчетчики
- •9.3. Сумматоры на основе пцу
- •9.4. Построение запоминающих устройств
- •Контрольные вопросы
- •Глава 10 Аналого-цифровые и цифро-аналоговые преобразователи
- •10.1. Аналого-цифровые преобразователи (ацп)
- •10.2. Ацп с интегрированием
- •10.3. Ацп c последовательным сравнением
- •10.4. Ацп с преобразованием измеряемой величины в кодируемый временной интервал
- •10.5. Ацп двоичного поразрядного уравновешивания
- •10.6. Основные характеристики ацп
- •10.7. Цифро-аналоговые преобразователи (цап)
- •Контрольные вопросы
- •Глава 11 Общая характеристика микропроцессоров
- •11.1. Использование микропроцессоров в иит
- •11.2. Структура микропроцессоров
- •11.3. Классификация микропроцессоров
- •11.4. Программное управление мп
- •11.5. Особенности построения модульных мп
- •11.6. Принципы организации эвм с использованием мп
- •Контрольные вопросы
- •Глава 12 Интерфейсы информационных и вычислительных систем
- •12.1. Назначение и характеристики интерфейсов
- •12.2. Принципы организации интерфейсов
- •12.3. Классификация интерфейсов
- •12.4. Системные интерфейсы мини- и микроЭвм. Общая характеристика системных интерфейсов
- •12.5. Интерфейсы мини- и микроЭвм рдр –11
- •12.6. Интерфейсы мини- и микроЭвм nova
- •12.7. Интерфейсы 8- и 16-разрядных микроЭвм
- •12.8. Устройства согласования системных интерфейсов
- •Контрольные вопросы
- •Глава 13 Малые интерфейсы стандартных устройств
- •13.1. Общая характеристика
- •13.2. Интерфейс ирпр
- •13.3. Интерфейс ирпс
- •Глава 14
- •14.1. Программно-модульный интерфейс iec 625-1. Общая характеристика интерфейса
- •14.2. Логическая организация интерфейса
- •14.3. Схемы поддержки и бис для интерфейса
- •14.4. Локальные системы на базе интерфейса
- •14.5. Интерфейсы магистрально-модульных и мультимикропроцессорных систем. Развитие интерфейсов системы камак
- •14.6. Интерфейсы системы Multibus
- •14.7. Интерфейс системы Fastbus
- •Контрольные вопросы
- •Глава 15 Интерфейсы и шины персональных эвм
- •15.1. Общая характеристика интерфейсов
- •15.2 Последовательный и параллельный интерфейсы
- •15.3. Универсальная последовательная шина usb
- •Топология
- •Кабели и разъемы
- •15.4. Интерфейс портативных компьютеров (pcmcia)
- •15.5. Шины персональных компьютеров эвм серии pc/at
- •Факс-модем
- •Принтер
- •15.6. Локальные шины (Local bus и vl-bus)
- •15.7. Интерфейс FireWare
- •Контрольные вопросы
- •Литература
- •Термины и определения
9.2. Cчетчики
Основные понятия
Последовательностное цифровое устройство, обеспечивающее хранение информации и выполнение над ним микрооперации счета, называется счетчиком.
Микрооперация счета заключается в изменении значении числа С в счетчике на ±1. Счетчик, в котором выполняется микрооперация счета С:=С+1, называется суммирующим, а счетчик, реализующий микрооперацию С:=С-1, - вычитающим. Счетчик называется реверсивным, если реализуются обе микрооперации.
Основным параметром счетчика является модуль счета КС, определяемый максимальным числом единичных сигналов, которое может быть сосчитано счетчиком. Счетчик, содержащий n двоичных разрядов, может находиться в состояниях 0, 1, 2, …., 2n-1. При поступлении на вход суммирующего счетчика 2n-й единицы он переходит из состояния 2n-1 в состояние 0. Таким образом, n-разрядный суммирующий двоичный счетчик имеет модуль счета КС=2n.
Счетчики характеризуются так же быстродействием, которое определяется допустимой частотой входных сигналов и временем установки состояния счетчика.
Счетчики обычно реализуются на Т-триггерах. Однако для их построения могут применяться не только триггеры со счетным входом, но и D-триггеры, JK-триггеры.
Счетчики можно классифицировать по нескольким признакам. В зависимости от направления счета различают суммирующие (с прямым счетом), вычитающие (с обратным счетом) и реверсивные (с прямым и обратным счетом). По способу организации схемы переноса различаются счетчики с последовательным и параллельно-последовательным переносом. В зависимости от наличия синхронизации различают синхронные и асинхронные счетчики.
При маркировке для обозначения счетчика используются буквы ИЕ. Конструктивно счетчики выполняются в виде совокупности интегральных схем - триггеров, соединенных соответствующим образом или в виде одной интегральной схемы, содержащей многоразрядный счетчик.
Суммирующие двоичные счетчики
В суммирующем двоичном n-разрядном счетчике, состоящем из триггеров, реализуется счетная последовательность чисел. Эта последовательность начинается с 0. Очередное число в этой последовательности получается прибавлением единицы к предыдущему числу. После того как последовательность доходит до максимального числа 2n-1, она снова проходит через 0 и повторяется. В счетчике с n триггерами число возможных состояний равно 2n, модуль счета КC так же равен 2n. Каждому состоянию счетчика соответствует число в счетной последовательности от 0 до 2n-1.Рассмотрим устройство двоичного 3-разрядного суммирующего счетчика. В таком счетчике можно реализовать счетную последовательность от 0 до 23-1=7. Последовательность чисел может быть задана совокупностью 3-разрядных двоичных чисел b3b2b1: 000, 001, 010, 011, 100, 101, 110, 111. Поставим в соответствие каждому разряду bi числа выход триггера Qi. В 3-разрядном счетчике с выходами Q3Q2Q1 будет реализовываться счетная последовательность от 0 до 7.
Счетчик может быть реализован с использованием двухступенчатых триггеров Т со счетным входом. Схема двоичного 3-разрядного суммирующего счетчика представлена на рис.9.2.1. В этой схеме исходное состояние счетчика устанавливается подачей сигнала по шине “Уст.0.” Триггеры Т изменяют свое состояние с окончанием входного сигнала, т.е. после перехода от уровня 1 к 0. Входной сигнал по шине С0 подается на счетный вход триггера 1. Работа счетчика может быть описана с помощью временной диаграммы (рис. 9.2.1).
Рис. 9.2.1. Структурная схема и временные диаграммы суммирующего счетчика
Закон функционирования счетчика можно представить в виде табл. 9.1., условное изображение счетчика приведено на рис. 9.2.2.
Таблица 9.1. Закон функционирования суммирующего счетчика
-
Номер комби-нации
С0
Состояния триггеров
Qt3
Qt2
Qt1
Qt+13
Qt+12
Qt+11
1
1
0
0
0
0
0
1
2
1
0
0
1
0
1
0
3
1
0
1
0
0
1
1
4
1
0
1
1
1
0
0
5
1
1
0
0
1
0
1
6
1
1
0
1
1
1
0
7
1
1
1
0
1
1
1
8
1
1
1
1
0
0
0
Рис. 9.2.2. Графическое обозначение двоичного счетчика
Работу счетчика можно так же представить как процесс суммирования предыдущего значения счетчика с единицей. Такое суммирование выполняется по обычным правилам выполнения операции сложения чисел в двоичной системе.
Вычитающие и реверсивные двоичные счетчики
В вычитающих счетчиках с приходом очередного счетного сигнала предыдущий результат уменьшается на единицу. В вычитающем двоичном n-разрядном счетчике реализуется счетная последовательность чисел, начиная с 2n-1 и кончая 0. Очередное число в этой последовательности получается вычитанием единицы из предыдущего числа. После получения значения 0 последовательность повторяется. Порядок смены состояний вычитающего счетчика может быть описан табл. 9.2.
Таблица 9.2. Порядок смены состояний вычитающего счетчика
-
Номер комби-нации
С0
Состояния триггеров
Qt3
Qt2
Qt1
Qt+13
Qt+12
Qt+11
1
1
1
1
1
1
1
0
2
1
1
1
0
1
0
1
3
1
1
0
1
1
0
0
4
1
1
0
0
0
1
1
5
1
0
1
1
0
1
0
6
1
0
1
0
0
0
1
7
1
0
0
1
0
0
0
8
1
0
0
0
1
1
1
Из таблицы следует еще одно отличие вычитающего счетчика от суммирующего: триггер каждого предыдущего разряда переходит в другое состояние при сигнале займа, обратном сигналу переноса в суммирующем счетчике. Поэтому вычитающий счетчик в отличие от суммирующего строится так, что со входом каждого последующего триггера соединяется инверсный выход предыдущего триггера. Схема вычитающего счетчика с последовательной передачей переносов приведена на рис. 9.2.3.
Рис. 9.2.3. Структурная схема вычитающего счетчика с последовательным переносом
Функционирование i-ого разряда вычитающего счетчика можно описать логическими выражениями переноса Пi+1 разности Сi по табл. 9.3.
Таблица 9.3. Функционирование i-ого разряда вычитающего счетчика
-
bi
Пi
Ci
Пi+1
0
0
0
0
0
1
1
1
1
0
1
0
1
1
0
0
Таблица получается на основании анализа особенностей вычитания единицы из двоичного числа. Из табл. 9.3. следуют логические выражения:
Разность Сi определяется тем же выражением, что и в суммирующем счетчике, поэтому перенос должен подаваться на счетный вход триггера Т. В отличие от суммирующего счетчика в выражении для Пi+1 вместо bi используется . Следовательно, на элементы И, формирующие переносы, подаются сигналы с инверсионных выходов триггера. Для ускорения работы вычитающих двоичных счетчиков могут использоваться схемы с параллельным и с параллельно-последовательным переносом.
В реверсивном счетчике объединяются схемы суммирующего и вычитающего счетчиков. Кроме того, существует возможность управления направлением счетчика, для чего предусматривается дополнительное КЦУ.
В реверсивном счетчике на Т-триггерах (рис. 9.2.4а) счетные сигналы поступают на вход Т-триггера через логические элементы, если они открыты единичными сигналами с выходов предыдущих разрядов.
Для счетных сигналов предусмотрены два входа. Если счетчик работает как суммирующий, сигналы счета следует подавать на вход «+1». Для вычитающего счетчика сигналы счета подаются на вход «-1». На выходе счетчика, обозначенном «>15», сигнал появляется при переходе счетчика в состояние с номером 15, в котором все триггеры установлены в состояние 1. На этом выходе формируется сигнал переноса в следующий счетчик. На выходе «<0» сигнал появляется при заполнении счетчика нулями. Это сигнал займа в следующий счетчик в схеме вычитающего счетчика. Условное обозначение реверсивного счетчика с двумя входами приведено на рис. 9.2.4б.
Рис. 9.2.4. Структурная схема реверсивного счетчика и его графическое обозначение
Синхронные и асинхронные двоичные счетчики
Двоичные счетчики, состояние триггеров которых изменяется одновременно под воздействием сигнала синхронизации на входах всех триггеров, получили название синхронных. Схема синхронного счетчика со сквозным переносом на Т-триггерах приведена на рис. 9.2.5а., его условное обозначение дано на рис. 9.2.5б.
а)
б)
Рис. 9.2.5. Структурная схема счетчика со сквозным переносом и его обозначение
Синхронные счетчики используются в синхронных цифровых системах. Последовательностные цифровые устройства в этих системах обычно зависят друг от друга и управляются от общего источника синхросигналов. В таких условиях нужно, чтобы все триггеры во всех ПЦУ изменяли свое состояние одновременно по сигналу синхронизации, чтобы текущее состояние триггеров использовалось для определения их следующего состояния. Применяемая здесь схема со сквозным переносом легко наращивается простым добавлением схемы И с двумя входами. Однако для определения значения самого правого входа Т n-разрядного счетчика необходимо время, равное времени распространения сигнала через одну схему И, умноженному на n-1.