- •Глава I
- •06Ласти применения эвм
- •1.6,1. СуперЭвм
- •Глава 2
- •8 Разрядов
- •11110001 11111001 11110001 11110111 А число — 6.285 запишется в память в виде слова из 6 байт:
- •Глава 3
- •Глава 4
- •Лечит узап j
- •Сверхоперативная или местная память
- •4.2. Адресная, ассоциативная и стековая организации памяти
- •Буфер входа-выхода
- •Усилители считывания-записи
- •Глава 5
- •Проклей
- •Идентификатор адреса (s байт)
- •Сектор на дискете
- •Глава 6
- •Управляющий блок автомат)
- •Глава 7
- •В цпршВляющай блок у б
- •Сумматор частичных произведений Регистр множимого
- •О vМножимое перед началом Выполнения умножения
- •Слой элементов и
- •Глава 9
- •Двойное слада па адреса о 32 бит
- •Слобо по адресу z в бит
- •Заслать в стек ад РеЗ
- •Загрузить аз стана в Pa V
- •Номер регист
- •Непосредственный операнд 1а
- •15Ю кГго 51
- •Оповещающий сив нал „Состояние
- •Блок ревастрод
- •Ветвление в макропроерамме по уело дую Акк*0
- •Макрокоманды управления последовательностью выборка микрокоманд
- •Окно процедуры
- •Регистры параметров (а) Регистры глобальных переменных |
- •1 Нуль м Знак-
- •Запоминание состояния процессора (программы)
- •Общий сигнал прерывания
- •Код приоритетного запроса
- •Маска ввоОагвывода
- •Прерывающая
- •01 23*56789 Время
- •I участка I
- •Запись льта мп
- •I Прием операндов на регистры 1
- •Умножение чисел с фиксированной точкой
- •Сложонив чисел с плавающей точкой
- •Глава 10
- •Вызов команды и модификация счетчика команд
- •Процедура тандемных пересылок
- •Однобайтная
- •16 Разрядов
- •Передача д стек а восстановление содержимого регистров
- •Команды досстаяовяения из стеки содержимого регистров
- •Блок сегментных регистров
- •Первый байт команды Второй ffaSm команды (постбайт адресации)
- •Сегментные селекторы
- •Регистры задачи и регистры дескрипторнои таблицы
- •Блок управления и контроля оп
- •Справочник страниц
- •Физическая память
- •16 Мбайт
- •Расширенная память
- •1 Мбайт
- •С каналом ес эвм
- •Связь с другой эвм
- •I Манипулятор % I Графа- I I типа „Мышь” I I построитель I
- •Глава 11
- •Интерфейс основной намята
- •Общее оборудование мультиплексного канала
- •Глава 12
- •Определения четности переносод
- •Глава 13
- •Ill:Выполнснис программы а Выполнение про ерам мы в
- •Пакеты заданий и Входные наборы данных
- •Выходные очереди разных классов в зу на дисках
- •I требует ‘'ода
- •Пользователь обдумывает | ответ системе I (новый запрос)
- •Блок управления памятью
- •Схемы совпадения
- •Шифратор номера отделения
- •Входной коммутатор
- •Коммутации
- •Сегментная таблица п-й программы
- •Векторные, средства
- •К периферийным устройством
- •К периферийным устройствам
- •Глава 15
- •Устройства Ввода- вывода
- •Процессор 2
- •Процессор 3
- •8 Векторных регистров (по 6* слова в каждом)
- •Готовности операндов
- •Глава 16
- •Комплекс абонентского пункта
- •16.2.. Классификация вычислительных сетей
- •1 Элемент
- •Время распрост- ранена*
- •Задержка сета лри коммутации пакетов[
- •Абонентская система
- •Данные пользователя
- •Сеансовый
- •Транспортный
- •Сетевой
- •Интерфейс высоког о уровня
- •Аппаратура передачи данных
- •Установление связи
- •Данные пользователя 00Длина поля и слови я обслуживания
- •Идентификатор протокола
- •7» Бшдта) Данные пользователя б вызове
- •Поток бит
- •Новый пакет (кадр)
- •Станция 1 ведет передачу
- •Передатчик Коаксиальный кйбель
- •Глава 15. Принципы организации многопроцессорных и многомашинных вычислительных систем (комплексов) и суперЭвм 489
- •1S в 7 о Слада па адресу ь
Эффективный,
адрес £л
(смещение)
15 О
|
Эффективный,
адрес
~|
'\\
_
19
»
j
Сегментный
адрес
| J
CS
^
Сумматор
j
US
19
Исполнительный
(физический) адрес
S5
,ш=
111!
ES
Рис.
10.10. Формирование исполнительного
(физического) адресаrr-Блок сегментных регистров
ihII>
лями в четырех младших разрядах. Другими словами, начальные адреса сегментов кратны 16 (рис. 10.9).
Физический адрес операнда или команды формируется, как это показано на рис. 10.10, суммированием начального адреса соответствующего сегмента (содержимого сегментного регистра, сдвинутого на четыре разряда влево и дополненного нулями в четырех младших разрядах) и так называемого эффективного адреса (смещения) ЕАУ формируемого командой на основе содержащейся в ней информации о способе формирования адреса.
Сегментные регистры позволяют осуществлять динамическое распределение памяти, необходимое для реализации мультипрограммного (многозадачного) режима работы МП (см. гл. 13). Перемещение программ и данных в памяти производится простым изменением сегментных адресов в сегментных регистрах.
Порты ввода-вывода адресуются подобно ячейкам памяти, но без использования сегментных регистров. Доступ к первым 256 портам возможен путем прямой адресации, остальные порты адресуются косвенно по регистру, указываемому командой.
Обработка прерываний. Микропроцессор обрабатывает внешние и внутренние (аппаратурные и программные) прерывания. Переход к прерывающей программе производится по присвоенным запросам прерывания номерам векторов прерывания, расположенным в таблице векторов в ОП. При использовании
Рис.
10.11.
Форматы команд #Ш К1810:
а— двухоперандная команда;б— команда с непосредственно адресуемым операндом;в— однооперандная команда;г, д— однобайтные команды
Первый байт команды Второй ffaSm команды (постбайт адресации)
disp
Н
Г
disp
L ~I Г
Мп |w|
imdl
КОп
\ г/т
Li
I I I I I III
■ I ■ ■ I | ■
data
L
"1
Г data
И
ГГ71
Л7In
I
г/т
Кдп
11111
disp
Н
disp
L
I
I
-L-L-LJ.J_J.jJ
LL
Способы
адресации.
Форматы
команд.КОпJ-
,1 I i I I I][l-J—L-I-1
.1
I»—1—*--»—^
I
I L В)-J
Lj-lj.a.1,1.В)[-I—L,
I I I5|И
mod
I КОпа)одной
БИС контроллера прерываний
возможна
обработка до 256 прерываний разных
типов: внешние маскируемые (запросы
поступают на входы контроллера
прерываний);
внешние немаскируемые (пропадание
напряжения питания, ошибка в ОП и
т. п.— запросы поступают на вход
незамаскированного^ прерывания
МП); внутренние аппаратурные,
вызываемые ошибками при делении
(переполнение, _попытка
деления на нуль), а так- | t*Pnt
,
|ге£ |же
«пошаговое прерывание», 111сопровождающее
пошаговую работу МП; программное,
задаваемое специальными командами,
включаемыми в программу (прерывания
по переполнению, точкам разрыва и др.).
В командах МП К1810 используются следующие
способы адресации: непосредственная,
прямая, регистровая прямая и
косвенная, относительная (базирование),
комбинация базирования и индексации
(без смещения и со смещением). При всех
способах адресации (кроме непосредственной
и регистровой прямой) формируется
эффективный адрес ЕА,
который, как уже указывалось, для
получения физического адреса
складывается с соответствующим
начальным сегментным адресом (рис.
10.10).
На рис. 10.11 представлены примеры
форматов команд [25J.
Команды имеют длину от 1 до 6 байт. В
первом байте команды или в первых
двух байтах содержатся код операции
и сведения о способе адресации. Команды
могут иметь Дополнительные (необязательные)
байты (показаны на Рис.
Ю.П штриховыми линиями), задающие: одно
(disp
L)- Или
двухбайтное (disp
Я,
disp
L)
смещение
(рис. 10.11, а);
°Дно
(data
L)-
или
двухбайтный (data
//,
data
L)
непосредственный
операнд; одно- или двухбайтное смещение,
за которым следует одно- или
двухбайтный непосредственный операнд
reg (г/т) |
§ II о |
w= 1 |
reg (г/т) |
w = 0 |
w = 1 |
000 |
AL |
АХ |
1 00 |
АН |
SP |
00 1 |
CL |
СХ |
1 0 1 |
СН |
ВР |
0 1 0 |
DL |
DX |
1 1 0 |
DH |
SI |
0 1 1 |
В |
ВХ |
1 1 1 |
ВН |
DI |
Таблица 10.2
mod |
Режим |
Пояснения |
00 |
disp = 0 |
Смещения нет |
0 1 |
disp = L |
8-битное смещение |
1 0 |
disp = disp Я, disp L |
16-битное смещение |
1 1 |
Регистровая адресация в |
соответствии с табл. 10.1 |
Таблица
10.3
г/т |
Эффективный адрес (смещение) (£>4) |
000 |
EA=(BX) + (SI)+disp |
00 1 |
EA=(BX) + (DI) + disp |
0 1 0 |
EA = (BP) + (SI)+disp |
0 1 1 |
ЕА = (BP) -j- (SI) -j- disp |
100 |
EA= (SJ)-\-disp |
1 0 1 |
EA= (DI)-\-disp |
1 1 0 |
EA=(BP) -j-disp |
111 |
EA=(BX) -\-disp |
Таблица
10.4
s, w |
Формат операнда |
Пояснения |
00 |
data L |
1 байт данных |
0 1 |
data Я, data L |
2 байта данных |
1 1 |
data L* |
1 байт данных с расширением |
|
|
знака до 16 бит |
(рис. 10.11, б); двухбайтное смещение и двухбайтный сегментный адрес; двухбайтный эффективный адрес (при прямой адресации) .
В двухоперандных командах (рис. 10.11, а) разряд w в первом байте команды указывает, выполняется операция над байтами (ад = 0) или над словами (ад=1). Первый операнд находится в памяти или в регистре, а второй — всегда в регистре, номер которого указан в поле reg второго байта команды. Присвоен-
цые регистрам номера приведены в табл. 10.1/Адрес операнда йожно трактовать как адрес источника или приемника. Результат операции записывается, как правило, по адресу приемника, разряд d в первом байте команды определяет, является ли рргистр, указываемый в поле regy источником (d = 0) или при- ем ником (d = 1).
Способ адресации первого операнда определяется полями mod и r/т второго байта команды. Если mod= 11, то первый операнд находится в регистре с номером, указанным в поле г/т команды. При moduli первый операнд находится в памяти, причем поле mod задает смещение согласно табл. 10.2, а поле rjm — способ формирования эффективного адреса ЕА в соответствии с табл. 10.3. Имеется лишь одно исключение для случая f mod = 00 и г/т=110, при котором формируется прямой физический адрес EA = disp //, disp L.
Таблицы 10.2 и 10.3 в совокупности показывают, насколько разнообразны используемые в МП К1810 способы адресации.
На рис. 10.11,6 представлен формат команды с непосредственно адресуемым операндом, содержащимся в одном или двух дополнительных байтах команды (data L или data Н, data L). Первый операнд адресуется в соответствии с полями mod и г/m, т. е. как и в предыдущей команде. Результат операции записывается на место первого операнда. Использование непосредственно адресуемого операнда позволило исключить из команды поля d и regy расширить поле КОп и ввести новое поле 5. Таблица 10.4 поясняет влияние полей s и w на формат непосредственно адресуемого операнда.
Формат однооперандной команды (рис. 10.11, в) с учетом сказанного выше в. специальных пояснениях не нуждается.
На рис. 10.11, г и д представлены форматы однобайтных команд соответственно с использованием регистровой адресации и с подразумеваемой адресацией одного или двух операндов.
Особенности структуры микропроцессора Intel 8088. Структура МП 8088, используемого в ряде моделей персональных компьютеров, представляет собой несколько упрощенный вариант структуры МП 8086 и К1810. Упрощение достигнуто, в первую очередь, за счет уменьшения ширины шины данных до 1 байта (8 линий) вместо 2 байт (16 линий) и некоторых других свя- Занных с более узкой шиной изменений (4-байтный буфер команд вместо 6-байтного, инициирование выборки команды, когда в буфере остался один байт — вместо двух в МП 086 и К1810 и др.), но при этом сохранены полная программная с°вместимость этих МП, 20-разрядный адрес, выполнение операми с 16-разрядными операндами, сегментные регистры, средства ^ержки мультипрограммного и многопроцессорного режимов.
Новые модели однокристальных 16- и 32-разрядных микропроцессоров (80286, 80386)
Микропроцессорная техника, быстро развивается — помимо огромного количественного роста промышленного выпуска микропроцессорных средств наблюдается интенсивное расширение их логических возможностей. Это расширение идет, с одной стороны, путем создания и пополнения наборов микропроцессорных схем, с другой стороны, путем развития архитектуры самих микропроцессоров.
Крупным расширением архитектурных возможностей микропроцессорных средств явилось создание БИС сопроцессоров, т. е. таких БИС, которые, работая параллельно и совместно с БИС центрального микропроцессора, разгружают его от выполнения ряда функций, которые он может выполнять лишь с помощью подпрограмм. Эти функции выполняются сопроцессорами с высокой скоростью параллельно с работой центрального микропроцессора. Такая комбинация микропроцессорных БИС существенно повышает производительность и точность вычислений микропроцессорной системы.
С однокристальным 16-разрядным микропроцессором могут работать:
арифметический 80-разрядный сопроцессор, на два порядка повышающий скорость выполнения высокоточных операций с плавающей точкой, а также выполняющий тригонометрические, экспоненциальные и логарифмические команды;
сопроцессор ввода-вывода, осуществляющий функции контроллера с двумя каналами прямого доступа к памяти, что позволяет выполнять операции ввода-вывода параллельно с выполнением вычислений центральным микропроцессором;
сопроцессоры ядра операционной системы, содержащие на кристалле в ПЗУ ядро ОС, а также ряд таймеров, блоки управления и прерывания и позволяющие достигнуть значительного ускорения работы операционной системы.
Некоторые из схем, входящих в набор микропроцессорных БИС, по своей сложности не уступают, а в ряде случаев могут превосходить БИС самих микропроцессоров.
Новые микропроцессорные средства с более развитой архитектурой и более высокой произродительностью создаются на основе совершенствования технологии БИС и СБИС, в том числе путем уменьшения размеров схемных компонентов, использования технологии комплементарных МОП-транзисторов, позволяющих снизить на порядок потребляемую мощность, расширить диапазон рабочих температур аппаратуры.
В качестве примеров МП следующих (по сравнению с М** £1810) поколений рассмотрим микропроцессоры $0286 и 80386 фирмы Intel, широко используемые в современных персональных компьютерах. В этих МП реализованы многие логические свойства, которые еще недавно считались принадлежностью лишь крупных ЭВМ (защита памяти, кэш-память, сегментированная виртуальная память и др.). Для лучшего понимания содержания данного параграфа полезно ознакомиться с материалами гл. 13 и 14.
Однокристальный 16-разрядный МП 80286 является существенным развитием МП 8086. Кристалл МП 80286 содержит 130 тыс. транзисторов, заключен в квадратный корпус с 68 контактами, расположенными по четырем сторонам корпуса. Используется один уровень питающего напряжения +5 В.
Микропроцессор 80286 содержит схемы управления и защиты памяти. Тактовая частота 8 или 10 МГц. Производительность этого МП в 2—3 раза выше, чем у МП 8086.
В МП реализуется конвейерная обработка команд и данных, многозадачный (мультипрограммный) и многопользовательский режимы работы. Емкость виртуальной памяти достигает 230, или I Гбайт, а физической 224, или 16 Мбайт.
При подключении к МП 80286 80-разрядного арифметического сопроцессора 80287 достигается значительное увеличение точности и скорости вычислений с числами с плавающей точкой, определения значений элементарных функций.
Программистская модель МП 80286 представлена на рис. 10.12 [35J. Она содержит наряду с регистрами, присутствующими в МП 8086, несколько дополнительных регистров, поддерживающих мультипрограммные и многопользовательские режимы.
Расширение средств отображения состояния МП достигнуто добавлением к обычному для структуры МП регистра флажков F регистра слова состояния машины — MSW. В частности, разряд разрешения запрета в этом регистре определяет альтернативные режимы работы МП: режим реального адреса или режим защищенного виртуального адреса.
Введены сегментные дескрипторы (см. гл. 9), описывающие размеры сегментов, права доступа, их базовые адреса. Имеется Лескрипторная таблица. Регистры дескрипторной таблицы — сегментные селекторы (LDTR, GDTR, IDTR) — указывают адреса дескрипторных таблиц.
Регистр задачи TR обслуживает переключение задач. Этот Регистр содержит адрес системного дескриптора сегмента, задающего область запоминания состояния машины (задачи) момент перехода задачи из активного состояния в состояние
Дания. Переход к обработке новой задачи осуществляется
Общие
регистры данных
АХ
Признаки
(флажки) Укйзатвль (счетчик) команд
Слово состояния машины
IКоманды
умно- ( женил\ деления
г
_ I и
ввода-вывода 1Р
ч
Счетчик
цик-
\ла,сдвига,
MSW
>
повторения
I
Базовые
г
регистры
15 О
Регистры
управления и состояния
Права
доступа 7 О 23
Базовый
адрес сегмента
Размер
сегмента О
15 О |
AL |
ВН |
BL |
СИ |
CL |
ВН |
BL |
| |
| |
| |
|