- •Цифровые устройства и микропроцессоры
- •1. Практические занятия по цифровым устройствам
- •1.1. Практическое занятие «Основы теории цифровых устройств» Учебные цели
- •Содержание занятия
- •Учебно-материальное обеспечение занятия
- •Содержание учебных вопросов
- •1. Тест на знание логических элементов ( лэ )
- •2. Перевод чисел из десятичной системы счисления в двоичную
- •3. Методика получения переключательной функции лэ
- •4. Минимизация переключательной функции методом
- •5. Построение цифрового устройства по переключательной
- •6. Построение цифрового устройства по переключательной функции в заданном базисе
- •1.2. Практическое занятие «Минимизация переключательных функций»
- •Ицхоки я.С., Овчинников н.И., Поздняков в.Г. Импульсные и цифровые устройства. – м.: ввиа, 1983. С. 41 – 61.
- •Конспект лекций.
- •1. Описание работы цифрового устройства на языке
- •2. Проверка работоспособности цифрового устройства
- •3. Построение и заполнение карты Карно
- •4. Минимизация пф с помощью карты Карно
- •5. Синтез цифровых устройств (общее задание для всех курсантов)
- •1.3. Практическое занятие «Синтез цифровых устройств»
- •Ицхоки я.С., Овчинников н.И., Поздняков в.Г. Импульсные и цифровые устройства. – м.: ввиа, 1983. С. 41-61.
- •Конспект лекций.
- •Синтез цифрового устройства по неполному словесному описанию
- •2. Синтез полусумматора
- •3. Синтез одноразрядного сумматора
- •1.4. Практическое занятие «Элементы цифровых устройств»
- •Конспект лекций.
- •Теоретическое исследование реакции триггеров на входные сигналы заданной формы
- •2. Теоретическое исследование реакции цифровых устройств
- •2. Практические занятия по микропроцессорным системам
- •2.1. Практическое занятие «Система команд микропроцессора»
- •2. Конспект лекций.
- •1. Шестнадцатеричная система счисления (сс)
- •1.1. Примеры перевода чисел из шестнадцатеричной сс
- •2. Система команд микропроцессора
- •Все команды по функциональному назначению делятся на шесть групп (см. На рис. 15 схему команд мп кр580вм80):
- •2.. 00000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000003. Программная реализация временной задержки
- •4. Выполнение индивидуальных заданий по составлению программ
- •2. Конспект лекций.
- •1. Принцип работы бис 580вв55
- •2. Программирование бис 580вв55( по индивидуальным заданиям)
- •3. Формирование управляющего сигнала для внешнего устройства
- •4. Разработка программы «Формирование управляющего сигнала для внешнего устройства» ( по индивидуальным заданиям)
- •2.3. Практическое занятие «Программируемый интервальный таймер бис 580ви53»
- •2. Конспект лекций.
- •1. Принцип работы бис 580ви53
- •2. Программирование бис 580ви53 (по индивидуальным заданиям)
- •3. Формирователь импульсов запуска внешнего устройства с большим периодом повторения импульсов ( общее задание)
- •2.4. Практическое занятие «Организация микропроцессорной системы (мпс)»
- •2. Конспект лекций.
- •1. Шины или линии групповой связи
- •2. Разработка схемы управления мпс и организация связей между бис мпс
- •Литература
2. Разработка схемы управления мпс и организация связей между бис мпс
2.1. Описание схемы включения ОЗУ
На рисунке 28 приведена схема включения одной ИМС ОЗУ. Шина адреса ( ША) МП используется как для выбора устройства, с которым работает МП (старшие разряды В1 адреса), так и для адресации внутри устройства (младшие разряды В0 адреса). При обращении к ОЗУ МП выставляет на ША адрес В1B0(16) . На выходе G (G = В1(10)) дешифратора появляется логическая 1, разрешающая прохождение либо сигнала «Чтение», либо сигнала «Запись» на вход CE (СS) ОЗУ. При поступлении сигнала «Чтение» из ОЗУ на ШД считывается двоичный код, записанный по адресу B0, а при поступлении сигнала «За-
пись» производится запись двоичного кода с ШД в ОЗУ по адресу B0.
Рис. 28
2.2. Разработка дешифраторов для схем управления ПЗУ и ОЗУ
Исходными данными для разработки дешифраторов являются началь- ные адреса ОЗУ и ПЗУ, примеры которых приведены в таблице 23.
Таблица 23
№ п.п. |
Начальный адрес |
А15 |
А14 |
А13 |
А12 |
А11 |
А10 |
А9 |
А8 |
А7 |
А6 |
А5 |
А4 |
А3 |
А2 |
А1 |
А0 |
1 |
ПЗУ |
0 |
0 |
0 |
0 |
0 |
0 |
0 |
0 |
0 |
0 |
0 |
0 |
0 |
0 |
0 |
0 |
|
ОЗУ |
1 |
0 |
1 |
1 |
0 |
0 |
0 |
0 |
0 |
0 |
0 |
0 |
0 |
0 |
0 |
0 |
|
|
|
|
|
|
|
|
|
|
|
|
|
|
|
|
|
|
2 |
ПЗУ |
0 |
0 |
0 |
0 |
0 |
0 |
0 |
0 |
0 |
0 |
0 |
0 |
0 |
0 |
0 |
0 |
|
ОЗУ |
0 |
1 |
0 |
0 |
0 |
0 |
0 |
0 |
0 |
0 |
0 |
0 |
0 |
0 |
0 |
0 |
|
|
|
|
|
|
|
|
|
|
|
|
|
|
|
|
|
|
3 |
ПЗУ |
0 |
0 |
0 |
0 |
0 |
0 |
0 |
0 |
0 |
0 |
0 |
0 |
0 |
0 |
0 |
0 |
|
ОЗУ |
0 |
1 |
1 |
0 |
0 |
0 |
0 |
0 |
0 |
0 |
0 |
0 |
0 |
0 |
0 |
0 |
|
|
|
|
|
|
|
|
|
|
|
|
|
|
|
|
|
|
4 |
ПЗУ |
0 |
0 |
0 |
0 |
0 |
0 |
0 |
0 |
0 |
0 |
0 |
0 |
0 |
0 |
0 |
0 |
|
ОЗУ |
1 |
1 |
0 |
0 |
0 |
0 |
0 |
0 |
0 |
0 |
0 |
0 |
0 |
0 |
0 |
0 |
|
|
|
|
|
|
|
|
|
|
|
|
|
|
|
|
|
|
5 |
ПЗУ |
0 |
0 |
0 |
0 |
0 |
0 |
0 |
0 |
0 |
0 |
0 |
0 |
0 |
0 |
0 |
0 |
|
ОЗУ |
1 |
0 |
1 |
0 |
0 |
0 |
0 |
0 |
0 |
0 |
0 |
0 |
0 |
0 |
0 |
0 |
Порядок разработки следующий (для примера используем данные варианта №1 таблицы 23):
из начального адреса ОЗУ выделите старшие разряды, начиная с разряда, в котором записана младшая из единиц (младшая «1» в А12, поэтому выбираем А15 А14 А13 А12). Эти разряды в шине адреса будут использованы для выбора активного устройства – либо ПЗУ, либо ОЗУ;
запишите двоичный код из цифр, соответствующих выделенным старшим разрядам (1011(2)). Этот код будет кодом адреса ОЗУ ;
аналогично из начального адреса ПЗУ запишите двоичный код из цифр, соответствующих выделенным старшим разрядам (0000(2)). Этот код будет кодом адреса ПЗУ ;
постройте дешифраторы схемы управления для ОЗУ и ПЗУ (см. рис. 28), используя полученные коды их адресов. Для построения дешифраторов используйте любые логические элементы.
2.3. Построение принципиальной схемы фрагмента МПС
ЗАДАНИЕ: требуется подключить ОЗУ 537РУ13 (рис.30) к микропроцессору (рис.29) через схему управления.
МЕТОДИКА ВЫПОЛНЕНИЯ:
-
соединить адресные входы А0–А9 ОЗУ с соответствующими разрядами шины адреса МП;
-
соединить входы-выходы DB0–DB4 ОЗУ с соответствующими разрядами шины данных МП;
-
подключить к МП дешифратор ОЗУ;
-
подключить входы CE, WE ОЗУ в соответствии со схемой включения, представленной на рис.28.
D |
CPU |
A |
0 |
|
0 |
1 |
|
1 |
2 |
|
2 |
3 |
|
3 |
4 |
|
4 |
5 |
|
5 |
6 |
|
6 |
7 |
|
7 |
|
|
8 |
|
|
9 |
|
|
10 |
|
|
11 |
|
|
12 |
|
|
13 |
|
|
14 |
|
|
15 |
-
A
RAM
DB
0
0
1
1
2
2
3
3
4
4
5
6
7
8
9
WE
CE
Рис.29 Рис. 30