- •1. Структура многоуровневой системы управления. Решаемые задачи и требования к системе.
- •Структура многоуровневой су:
- •2. Структура и устройства управляющей микропроцессорной системы. Способы аналоговой обработки данных.
- •4. Схемы сопряжения устройств озу, пзу и портов ввода/вывода с шинами системной магистрали.
- •Управление доступом к устройствам мп-системы:
- •5. Применение дешифраторов, ппзу и плм в схемах выборки устройств мп-системы.
- •6. Структура и интерфейс 8-разрядного микропроцессора.
- •7. Цикл выполнения команды 8-разрядного микропроцессора.
- •8. Диаграмма машинного цикла 8-разрядного микропроцессора. Типы машинных циклов, используемых при выполнении команд. Диаграмма цикла микроконтроллера mcs-51.
- •9. Системный контроллер мп – системы и системные сигналы управления.
- •10. Программистские модели 8-разрядных микропроцессоров (ресурсы, способы представления данных и виды адресации, слово состояния программы). Работа со стеком.
- •11. Структура и интерфейс микроконтроллеров с архитектурой cisc (на примере mcs-51).
- •12. Логическая организация памяти микроконтроллера mcs-51.
- •13. Характеристика системы команд микроконтроллера мcs-51. Слово состояния программы, типы данных, способы адресации. Организация ветвлений в программах.
- •14. Состав и назначение регистров специальных функций в микроконтроллерах.
- •15. Базовые арифметические операции целочисленной 8-разрядной двоичной арифметики. Признаки результата.
- •16. Операции умножения/деления двоичных чисел.
- •17. Арифметическая обработка многобайтных операндов в микропроцессорах и микроконтроллерах с 8 – разрядной архитектурой.
- •18. Сложение-вычитание многобайтных 2-10 чисел в 8-разрядных микропроцессорах и микроконтроллерах.
- •19. Логическая обработка данных в микроконтроллерах. Битовые операции. Вычисление логической функции, аргументы которой поступают по входным линиям порта (задача).
- •20. Порты параллельного синхронного ввода-вывода мп систем. Программирование ввода-вывода.
- •21. Схемы портов параллельного асинхронного ввода-вывода мп – систем.
- •22. Структурная схема параллельного программируемого интерфейса. Основные режимы работы.
- •23. Организация ввода-вывода данных по запросам прерываний от схемы программируемого параллельного интерфейса.
- •24. Схемы и принципы работы двунаправленного (p0) и квазидвунаправленных портов (p1, p2, p3) микроконтроллеров mcs-51.
- •25. Режимы работы портов ввода-вывода микроконтроллеров avr.
- •26. Параллельный обмен данными с внешними устройствами в микроконтроллерных системах. Обмен с квитированием.
- •27. Схема, основные режимы работы и программирование таймера микроконтроллера mcs51.
- •28. Применение таймеров mcs51 для отсчета времени, измерения длительности сигнала, подсчета событий, формирования периодических сигналов.
- •1. Подсчет числа импульсов, поступающих на вход мк51 за 10мс.
- •2. Измерение длительности сигнала, поступающего на вход .
- •3. Организовать временную задержку длительность 500мс
- •29. Таймеры микроконтроллеров avr. Использование таймеров для сравнения, захвата событий, формирования шим-сигналов, в сторожевом режиме.
- •30. Основные функции системы прерываний.
- •31. Способы программной и аппаратной идентификация запроса прерываний в одноуровневых и многоуровневых системах прерываний.
- •32. Механизм обработки векторных прерываний в мп-системах с помощью команд rst n и call addr.
- •Радиально - векторная система прерываний (на примере микропроцессора i8085).
- •33. Контроллер прерываний. Структура, интерфейс, способы обработки прерываний.
- •34. Построение системы прерываний с несколькими контроллерами. Идентификация запроса прерываний.
- •35. Программирование контроллера прерываний. Назначение управляющих слов при инициализации контроллера и во время работы.
- •36. Система прерываний микроконтроллера mcs51. Работа со стеком.
- •37. Структура и основные режимы работы канала последовательного ввода-вывода uart микроконтроллера mcs-51.
- •38. Программирование приёма/передачи данных по каналу uart между двумя микроконтроллерами.
- •39. Организация обмена данными между микроконтроллерами при работе в сети.
- •40. Схема интерфейса микроконтроллера mcs-51 с внешней памятью программ, внешней памятью данных и дополнительными портами ввода-вывода.
- •41. Основные средства и способы организации взаимодействия микроконтроллера с клавиатурой и дисплеем.
- •42. Контроллер клавиатуры и дисплея - структура и программируемые операции.
- •2. С электронной коммутацией датчиков.
- •3. С кодированным сканированием (электрическая коммутация)
- •43. Применение ацп и цап в мп-системах.
- •44. Устройства энергонезависимой памяти с последовательным интерфейсом (на примере at25, at45).
- •45. Память DataFlash -структура, операции, применение.
- •47. Организация адресного пространства микроконтроллеров avr, способы адресации памяти программ и памяти данных.
- •48. Интерфейсы последовательной связи uart, spi, i2c.
- •49. Системы на кристалле: типы cSoC, структура, основные характеристики и функции, среда проектирования.
- •Основные характеристики
49. Системы на кристалле: типы cSoC, структура, основные характеристики и функции, среда проектирования.
Достоинства систем на кристалле (SoC).
1. Повышение производительности.
2. Снижение энергопотребления.
3. Уменьшение габаритов и цены.
Классификация SoC:
1. SoC.
2. CSoC (конфигурируемые системы на кристалле)
2.1. Стандартные.
2.2. Специализированные.
3. PSoC (программируемые системы на кристалле)
3.1. С однородной структурой (Soft – ядра (IP – ядра))
3.2. С блочной структурой (Hard – ядра)
4. SoPC (система на кристалле программируемая)
Структурная схема Triscend ES:
MCU – микропроцессорное устройство.
CSL – конфигурируемая системная логика.
PIO – порты ввода/вывода.
CSI – конфигурационная система передачи.
DMA – контроллер ПДП.
MIV – контроллер внешней памяти объёмом до 256 Кб.
Пользователь может программировать CSL, PIO и CSI.
FPSLIC – МС системного уровня интеграции, программируемая пользователем.
AT94xx
Для проектирования используется пакет System Designer:
1. AVR Assembler v.1.3
2. Редактор языка описания аппаратуры HDL planer (VHDL – Verilog)
3. Синтезатор языка описания аппаратуры (сокращенная библиотека логических элементов FPGA, Atmel)
4. Среда размещения и разводки FPGA.
НУЖНО ЛИ ГОВОРИТЬ ПО PSOC СYPRESS?
-
50. 32-разрядные микроконтроллеры на основе ядра ARM7TDMI.
-
Основные характеристики
-
32-разрядный RISC процессор
-
32-разрядная адресация - линейное адресное пространство в 4 Гбайта
-
Тридцать один 32-разрядный регистр общего назначения и шесть регистров состояния
-
Регистры адресов, записи и конвейера
-
Циклическое сдвиговое устройство и перемножитель
-
Трехуровневый конвейер (выборка команды, ее декодирование и выполнение)
-
Быстрый отклик на прерывания применений реального масштаба времени
-
Поддержка систем виртуальной памяти
32-разрядная система команд ядра ARM7 содержит одиннадцать базовых типов команд:
-
- Два типа используют встроенное арифметико-логическое устройство, циклическое сдвиговое устройство и умножитель при операциях над данными в банке из 31 регистра, форматом по 32 разряда каждый;
-
- Три класса команд управления перемещением данных между памятью и регистрами, один оптимизированный на обеспечение гибкости адресации, другой под быстрое контекстное переключение и третий под подкачку данных;
-
- Три команды управляют потоком и уровнем привилегии выполнения;
-
- Три типа предназначены для управления внешними сопроцессорами, что позволяет расширить функциональные возможности системы команд за пределами ядра.
Необходимо отметить, что программы, подготовленные даже для довольно эффективной 32-разрядной ARM системы команд, требуют памяти значительного объема, что в свою очередь приводит к росту общей стоимости системы. Специалисты фирмы ARM предложили решение этой проблемы, разработав и внедрив технологию Thumb, технологию, позволяющую существенно сократить объем кодов, необходимых для реализации той же программы, что выполняется на 32-разрядной ARM системе команд. До настоящего времени эта технология считается лучшей из технологий, использующих сжатые системы команд.
Конвейерная обработка реализована таким образом, что все компоненты систем памяти и обработки работают непрерывно. Обычно, в то время как одна команда выполняется, следующая команда декодируется и третья команда выбирается из памяти. Возможности системы команд ARM7TDMI могут быть расширены за счет добавления до 16 внешних сопроцессоров. Интерфейс памяти идеально подходит для организации взаимодействия как со встроенной на кристалл памятью, так и с внешней памятью, с блоками Flash памяти, что позволяет реализовать внутрисистемное программирование, защиту памяти, снизить время выхода на рынок, сократить общую стоимость системы. Интерфейс с памятью у процессора ARM7TDMI организуется следующими основными элементами:
-
32-разрядной шиной адреса, определяющей адрес ячейки памяти, которую необходимо использовать.
-
32-разрядной двунаправленной шиной передачи данных D[31:0], плюс двумя отдельными однонаправленными шинами данных DIN[31:0] и DOUT[31:0], через которые перемещаются команды и данные. Данные могут иметь формат слова, полуслова или байта.
-
Сигналами управления, определяющими, например, формат перемещаемых данных и направление их передачи и, кроме того, уровень приоритета.
Этот набор сигналов позволяет ARM7TDMI достаточно просто организовывать интерфейс с DRAM, SRAM и ROM. Для полного использования страничного режима доступа к DRAM, обеспечивается информация о том, является доступ к памяти последовательным или нет. Вообще говоря, интерфейс со статической памятью намного проще, чем интерфейс с динамической памятью. Как уже отмечалось выше, высокопроизводительное 32-разрядное статическое RISC ядро ARM7TDMI занимает на кристалле очень малую площадь, малое потребление энергии ядром позволяет использовать его в критичных к потреблению применениях, технология Thumb позволяет использовать память 16-разрядного формата меньшей емкости и, соответственно, меньшей стоимости.
При разработке этих макроядер фирма ARM ориентировалась на конкретные области применения, где особенности каждого макроядра позволят реализовать дополнительные возможности без существенного прироста стоимости. Добавление к макроядрам встроенного кэша позволяет минимизировать время доступа к внешней памяти и, сохраняя максимальную производительность, позволяет использовать недорогие RAM. Становится возможным использование системной шины и внешней памяти с быстродействием более низким, чем быстродействие процессора и, следовательно, уменьшить потребление. Широкая полоса частот системной шины может быть также использована и для увеличения полной производительности системы - высвобожденную полосу частот могут использовать другие периферийные устройства, обеспечивая высокую пропускную способность данных в устройствах типа MPEG декодеров цифровых TV приставок.
ЛЕКЦИИ ЕСТЬ?